Conception des circuits CMOS
analogiques
Conception transmetteur de
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Conception transmetteur de
puissance sans fil entièrement
intégré – Cours de restructuration
Alexandre Boyer
alexandre.boyer@insa-toulouse.fr
www.alexandre-boyer.fr
2015-2016
• A faire
• Schématique du circuit
• Description des différentes fonctions
• Circuit pin-out
• Liste, type des E/S, alimentations
•
Composants externes requis, circuits externes
Rapport de spécification
APP de Conception CMOS analogique en 5e année ESE
•
Composants externes requis, circuits externes
typiques
• Stratégie de protections ESD
• Spécifications détaillées
• Schéma détaillé des blocs analogiques à concevoir
• Technologie CMOS 0.35 µm 50 V (process H35B4S1)
• Intégration sur une même puce d’étages de puissance (haute tension
50 V) et de commande (faible tension 3.3/5 V)
• Nœud technologique « ancien », mais robuste, fiable, adapté aux fortes
tensions
• Composants disponibles (cf. ENG-238_rev6.pdf) :
•
NMOS/PMOS (LV and HV cores
-
3.3 V à 50 V)
Design kit AMS H35
APP de Conception CMOS analogique en 5e année ESE
•
NMOS/PMOS (LV and HV cores
-
3.3 V à 50 V)
• Bipolaire NPN/PNP vertical/latéral
• Diodes
• Résistances (diffusion, Nwell, POLY1/2/H)
• Condensateurs (MIM, POLY, POLY-Metal)
• Transistors MOS
• Liste des NMOS (Liste PMOS quasi identique)
Design kit AMS H35
Tensions nominales : 3.3 V, 5 V, 20
V, 50 V (Vgs, Vds, Vdb)
Versions isolées / non isolées
APP de Conception CMOS analogique en 5e année ESE
• Transistors MOS – Section du wafer (ENG-236_rev6.pdf)
Design kit AMS H35
Bulk = VDD
Bulk = VSS
Source = VSS
Source = VDD
VDD = 3.3 – 5 V
VSS = 0 V
APP de Conception CMOS analogique en 5e année ESE
VSS
P-substrate
N-well
P-substrate
Caisson N-well
P-well N-well
VSS
Bulk = VSS
Source = VSS Bulk = VDD Source = VDD
Isolation par jonction
Tub = VDD
Tub = VDD
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